一個(gè)上拉電阻可以設(shè)置在連接邏輯門和其輸入端之間。例如，一個(gè)輸入信號(hào)可以被一個(gè)電阻拉高，而一個(gè)開關(guān)或者帶跳線可以將輸入端和地相連。這可以被用作信息配置、選擇，或者對(duì)外部設(shè)備信號(hào)進(jìn)行檢錯(cuò)糾錯(cuò)。

上拉電阻可以在邏輯設(shè)備不提供電流的時(shí)候工作。集電極開路就具有上拉電阻，這樣的電路輸出信號(hào)常常在驅(qū)動(dòng)外部設(shè)備、組合邏輯電路、多個(gè)設(shè)備連接到一個(gè)總線的情況里應(yīng)用。

上拉電阻可以和其他邏輯設(shè)備一起焊接在同一個(gè)電路板上。許多微控制器希望嵌入式控制應(yīng)用程序使用內(nèi)部的、可編程的上拉電阻，減少對(duì)外部組件的需求。

上拉電阻的缺點(diǎn)是當(dāng)電流流經(jīng)時(shí)其將消耗額外的能量，并且可能會(huì)引起輸出電平的延遲。某些邏輯芯片對(duì)于經(jīng)過上拉電阻引入的電源供應(yīng)瞬間狀態(tài)較為敏感，這樣就迫使為上拉電阻配置獨(dú)立的、帶有濾波的電壓源。

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